Przejrzysty wykład z zakresu projektowania układów cyfrowego przetwarzania sygnałów obejmujący najnowsze zagadnienia syntezy logicznej, syntezę strukturalną, języki specyfikacji sprzętu (VHDL, Verilog) oraz metody projektowania hierarchicznego ze szczególnym uwzględnieniem układów programowalnych PLD/FPGA. Wartość merytoryczną książki podnosi opis zaawansowanych procedur syntezy logicznej
(dostępnych nieodpłatnie na stronie
www.zpt.tele.pw.edu.pl) wspomagających komercyjne systemy projektowania i umożliwiających skuteczną redukcję zasobów sprzętowych niezbędnych do realizacji układów cyfrowych w strukturach PLD/FPGA.
Książka ani w całości, ani we fragmentach nie może być skanowana, kserowana, powielana bądź rozpowszechniana za pomocą urządzeń elektronicznych, mechanicznych, kopiujących, nagrywających i innych, w tym również nie może być umieszczana ani rozpowszechniana w postaci cyfrowej zarówno w Internecie, jak i w sieciach lokalnych bez pisemnej zgody posiadacza praw autorskich.